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时钟、PLL与低功耗模块寄存器优化

时间:2023-06-24 理论教育 版权反馈
【摘要】:(一)试验条件试验在水科院泥沙所14m×0.5m×0.5m活动玻璃水槽中进行。流量由闸阀调节,大小由三角堰量测。从下游闸板向上游0.4m处开始,每1.5m设一观测断面。3种低功耗模式的具体介绍见表4-10。实际使用的试验沙粒径级配如图1。(续)图1试验用沙颗粒级配曲线对于28x设备,即使输入至CPU的时钟CLKIN关闭时,JTAG端口仍然会起作用,因此调试器也可以使设备退出STANDBY和HALT模式。

时钟、PLL与低功耗模块寄存器优化

1.PLL状态寄存器(PLLSTS)

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PLL状态寄存器的各位功能见表4-2。

4-2 PLL状态寄存器(PLLSTS)各位功能描述

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(续)

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2.PLL控制寄存器(PLLCR)

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PLLCR用来改变设备的PLL倍频系数,在向PLLCR进行写操作之前,需要满足以下要求:

●PLLSTS[DIVSEL]位必须被置零(CLKIN被4分频),只有当PLL锁定完成后(PLL-STS [PLLLOCKS]=1),才能将PLLSTS[DIVSEL]位修改为1。

●设备不能工作在“保护模式”,即PLLSTS[MCLKSTS]位必须为0。

当CPU对PLLCR[DIV]进行写操作时,PLL逻辑将CPU时钟(CLKIN)设定为OSC-CLK/2。一旦PLL稳定并已经锁定在一个新的指定频率,PLL将置CLKIN为表4-3中所示的一个新值。此时PLLSTS中的PLLOCKS位将置位,表明PLL已经完成锁定并且设备正运行在一个新的频率。用户可以通过软件查询PLLLOCKS位来判断PLL是否完成锁定。当PLLSTS[PLLLOCKS]变为1后,即可修改DIVSEL的值。

PLLCR对SYSCLKOUT的影响见表4-3,其中k为PLLCR[DIV]值对应的十进制值。

4-3 PLL控制寄存器(PLLCR)SYSCLKOUT的影响

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修改PLLCR的流程如图4-5所示。

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图4-5 PLLCR修改流程图

3.高速外设时钟预定标寄存器(HISPCP)

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高速外设时钟预定标寄存器的各位功能见表4-4。

4-4 高速外设时钟预定标寄存器(HISPCP)各位功能描述

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4.低速外设时钟预定标寄存器(LOSPCP)

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低速外设时钟预定标寄存器的各位功能见表4-5。

4-5 低速外设时钟预定标寄存器(LOSPCP)各位功能描述

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5.外设时钟控制寄存器0(PCLKCR0)(www.xing528.com)

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外设时钟控制寄存器0的各位功能见表4-6。

4-6 外设时钟控制寄存器0(PCLKCR0)各位功能描述

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(续)

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6.外设时钟控制寄存器1(PCLKCR1)

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外设时钟控制寄存器1的各位功能见表4-7。

4-7 外设时钟控制寄存器1(PCLKCR1)各位功能描述

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7.外设时钟控制寄存器3(PCLKCR3)

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外设时钟控制寄存器3的各位功能见表4-8。

4-8 外设时钟控制寄存器3(PCLKCR3)各位功能描述

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(续)

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8.低功耗模式控制寄存器(LPMCR0)

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低功耗模式控制寄存器的各位功能见表4-9。

4-9 低功耗模式控制寄存器(LPMCR0)各位功能描述

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3种低功耗模式的具体介绍见表4-10。

4-10 3种低功耗模式介绍

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(续)

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对于28x设备,即使输入至CPU的时钟CLKIN关闭时,JTAG端口仍然会起作用,因此调试器也可以使设备退出STANDBY和HALT模式。

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